dsp学习总结

dsp学习总结（精选9篇）

dsp学习总结 第1篇

DSP学习总结

根据一学期以来对DSP这门课程的学习，学到了很多DSP相关的知识。了解了如何根据实际需求选择DSP芯片，也知道了C54x的汇编和链接过程，还掌握了C54x的寻址方式。对于老师的授课方法也有一定的见解。

开始学DSP的时候比较着急，因为也感觉什么都不会，不知道从哪里下手。手上的资料只有书，后来去图书馆看了两本，一本是《DSP原理与开发》，除了有详细的理论说明之外，还会在每个章节之后配上一个例程，缺点就是错误也不少，估计时间太仓促，校对没做好。另一本书是清华大学出版社的《TMS320C28X系列DSP的CPU与外设》，是从TI的英文的技术手册翻译过来的，分上、下两册，可以作为工具书，很实用，缺点是没有例子。书看了一两遍，觉得还是一头雾水。后来有相应的实验开课，慢慢对DSP有点了解了，刚开始都不知道怎么建PROJECT，后来问了同学，然后再看TI的例程，仿照它的程序框架，边看例程，边对着实验指导书，看得主要是如何初始化，需要对每个外设进行哪些寄存器的初始化，寄存器为什么这样设置，程序如何进中断，如何出中断等等。边看书边做实验，效率会高很多，也就能慢慢理解了。

对于刚学DSP的新手我觉得掌握一些初级知识就差不多了。

第一步：硬件入门。1.先学习DSP的硬件基础：了解CPU结构、中断、EMIF、HPI、GPIO、SPI、Timer、供电方式、时钟；2.了解DSP互连的存储器：SDRAM、FLASH、FIFO、双口RAM、SDSRAM等不需深入研究；3.了解CPLD/FPGA的硬件结构、连接原理、VerilogHDL编程语言需深入研究；4.了解DSP Bootloader不需深入研究；5.了解DSP和外部通信的接口：PCI、USB、LAN、UART等，有时间可以看看DM642的VideoPort

第二步：工具入门。1.学习数字电路、模拟电路、电路分析的知识；2.学好一种PCB绘制软件如Protel DXP2006；3.学习信号完整性、学习传输线理论，特性阻抗知识；

关于老师上课的方式我认为：1.太多的理论知识枯燥乏味，因为有实验课，我觉得老师可以根据实验要做的内容在课堂上深入讲解，这样在讲述的同时能让同学们认真听，认真记以便于实验课程的顺利完成，比纯理论效果会好点。2.课上应该多讲解一些例子，由浅而深，我觉得上课关键是调动同学的积极性，能吸引学生的很多是夹杂着现实生活中的事，中国的DSP才刚刚起步，发展正方兴未艾，严格意义上符合DSP两大核心特征的公司，更是非常之少，整个国内网络展示广告领域对于DSP的理解都远远没有达到普及的程度，有很大的发展潜力，让同学们意识到学习DSP是有用的。

dsp学习总结 第2篇

a)EALLOW;//防止私自写或覆盖寄存器的内容，加了这句，接下来可以操作寄存器了 b)GpioCtrlRegs.GPAMUX1.bit.GPIO0 = 0;// GPIO0复用为普通I/O功能 c)GpioCtrlRegs.GPADIR.bit.GPIO0 = 1;// 1，设置为输出；0设置为输入 d)EDIS;//加了这句，接下来不可以操作寄存器

注：EALLOW,EDIS总是成对出现中断过程（代码以配置SCIB模块的接收中断为例，LSPCLK是37.5MHz）

中断共分三级，1，外设级；2，PIE级；3，CPU级；外设级的中断标志必须手动清零；PIE级和CPU级的中断标志位由硬件自动清零。中断响应例程：

第一步，配置中断源，即允许产生什么类型点中断。例如，定时器中断，串口中断，外部中断等。ScibRegs.SCICTL2.bit.RXBKINTENA =1;允许接收中断

第二步，配置PIE(外部中断扩展)

a)InitPieCtrl();//初始化Pie控制

b)InitPieVectTable();//初始化Pie向量表控制

c)EALLOW;

d)PieVectTable.SCIRXINTB=&scibreceive;//指定中断服务程序地址e)EDIS;

f)PieCtrlRegs.PIECTRL.bit.ENPIE=1;//使能从PIECTRL中读取中断向量 g)PieCtrlRegs.PIEIER9.bit.INTx3=1;//使能SCIB的接收中断

h)IER |= M_INT9;//允许外部中断

i)EINT;

j)ERTM;

第三步，中断响应

在中断服务程序里，必须用PieCtrlRegs.PIEACK.all = PIEACK_GROUP9;//清楚中断已响应标识，再写自己等程序代码串口配置

InitScibGpio();scib_echoback_init();AD转换

InitAdc();//允许ADC时钟，带隙和参考电路上电，核中模拟电路上电

AdcRegs.ADCTRL2.all = 0x2000;//ADC模块开始转换

程序在FLASH运行时，需要加如下两句代码：（不知道具体原因）

DSP学习小结 第3篇

DSP是Demand-Side Platform的缩写，即需求方平台。这一概念起源于网络广告发达的欧美，是伴随着互联网和广告业的飞速发展新兴起的网络广告领域。它是一种独特的微处理器，是以数字信号来处理大量信息的器件。其工作原理是接收模拟信号，转换为0或1的数字信号，再对数字信号进行修改、删除、强化，并在其他系统芯片中把数字数据解译回模拟数据或实际环境格式。它不仅具有可编程性，而且其实时运行速度可达每秒数以千万条复杂指令程序，源源超过通用微处理器，是数字化电子世界中日益重要的电脑芯片。它的强大数据处理能力和高运行速度，是最值得称道的两大特色。

DSP核心特征：一个真正意义的DSP，必须拥有两个核心特征，一是拥有强大的RTB(Real-Time Bidding)的基础设施和能力，二是拥有先进的用户定向(AudienceTargeting)技术。

DSP系统的设计还没有非常好的正规设计方法。在设计DSP系统之前，首先必须根据应用系统的目标确定系统的性能指标、信号处理 的要求，通常可用数据流程图、数学运算序列、正式的符号或自然语言来描述。第二步是根据系统的要求进行高级语言的模拟。

在完成第二步之后，接下来就可以设计实时DSP系统，实时DSP系统的设计包括硬件设计和软件设计两个方面。

系统的软件和硬件分别调试完成后，就可以将软件脱离开发系统而直接在应用系统上运行。

DSP优点是对元件值的容限不敏感，受温度、环境等外部因素影响小；容易实现集成；VLSI可以分时复用，共享处理器；方便调整处理器的系数实现自适应滤波；可实现模拟处理不能实现的功能：线性相位、多抽样率处理、级联、易于存储等；可用于频率非常低的信号。

DSP缺点是需要模数转换；受采样频率的限制，处理频率范围有限；数字系统由耗电的有源器件构成，没有无源设备可靠。但是其优点远远超过缺点。

DSP调试总结 第4篇

在这个过程中，并没有用DSP做多少事情，只是有一个FFT计算和EMIF口以及MCBSP口的数据与控制命令的传输，总体来说功能还是蛮简单的。

1、首先，FFT运算直接调用TI的C64XX的库函数就可以完成。在这个调试过程中，首先使用的是simulater环境进行软件仿真计算，根据计算出来的谱图发现结果是正确的，只是模拟数据和旋转因子在软仿真的时候耗费的时间太长（32K点）。可由MATLAB产生数据，然后导入数组，直接进行FFT验证之。

FFT消耗时间分析：在软件中可以设置观测FFT函数所消耗的时间，最后由两种结果，Total cycle 和Cpu cycle，其根据600M主频计算下来，做32K点时其耗时相差有100倍，即百毫秒与毫秒的差别，由于不确定时间应采取哪种，所以进而进行了板级实验。

在板级实验过程中，发现程序“经常偶尔”跑飞，一直也没有找到原因。最后经过多次试验用示波器检测出来的时间与用Cpu cycle计算出来的相近。此时，我们假设Cpu cycle是正确的，那换算出来的主频就只为400M。用示波器对分频时钟进行测试，发现现在CPU确实只工作在400M的主频，而不是最大600M的主频。

由此说明，芯片的配置可能有问题，并且还可以证明可以用Cpu cycle来计算程序的运行时间（当然DSP主频要确定）。

经databook查询，发现晶振的频率与其设置的主频选择有误，及用此晶振的频率，要改变外围电路配置才能达到最高频率。当然，也许maybe可能这个问题与DSP经常跑飞有关联。

改了之后发现其运行在666M的状态，超了66M，不晓得对芯片有没有影响，知道的大神可告知小弟，不胜感激...2、EMIF 与 MCBSP 的可按照自己的需要进行配置初始化。

DSP复习总结(精) 第5篇

1.DSP的优势:可控性强,稳定度高,精度高,抗干扰性强,实现自适应性,数据压缩, 大规模集成。

2.实时数字信号处理:信号处理速度必须大于等于输入信号更新的速度,而且信号输入到

处理后输出的延迟必须足够的小

实时取决因素:芯片速度,运算量(数据率,算法复杂度

3.DSP子系统实现方式:通用CPU,加速处理模块,单片机,专用DSP芯片,可编程FPGA 器件,通用可编程DSP芯片

3.DSP系统典型处理方法:数据流处理。块处理 矢量处理

4.定点与浮点DSP芯片 定点: 小数Xf转换为定点数Xd:Xd=int(Xf×2Q 定点数Xd转换为小数Xf:Xf=float(Xd×2-Q 0.25的Q15表示法——0.25×215=8192=0x2000 0x4623的Q15表示小数——17955×2-15=0.547943 第一位为符号位

浮点: bit3bit3bit2bit2bit S e f 浮点数=(-1S×2(e-127×1.f-0.75=-(0.112=-(1.1×2-1=(-11×(1.1×2(126-127-0.75的IEEE单精度浮点格式数为:(BF400000H 5.DSPs芯片特点

算数单元:硬件乘法器是DSPs区别于早期通用微处理起的重要标志 多功能单元使DSP在单位时间内完成更多的操作,提高了程序执行速度 总线结构:哈弗总线结构

流水技术:是提高DSPs程序执行效率的另一个重要手段 专用寻址单元:地址的计算不再额外占用CPU时间 片内存储器:程序存储,数据存储,CACHE 丰富的外设

6.DSP处理器实现高速运算途径 ⏹硬件乘法器及乘加单元 ⏹高效的存储器访问 ⏹数据格式 ⏹零循环开销 ⏹多个执行单元

⏹数据流的线性I/O ⏹专门的指令集

6.DSP评价方法:传统性能评价 MIPS-----百万指令每秒 MOPS-----百万操作每秒 MFLOPS-----百万浮点操作每秒 MACS-------乘加次数每秒 完整应用评价 核心算法评价

7.选型依据:速度,精度,芯片资源,开发工具,支持多处理器,功耗与电源管理,成本。

8.哈佛总线结构包括6条总线:PAB(程序地址总线,DRAB(数据读地址总线,DW AB(数据写地址总线,PRDB(程序读地址总线,DRDB(数据读总线,DWEB(数据写总线

第二章.TMS320C200 DSP处理器 1.内部结构

三个主要组成部分:中央处理单元,存储器,外设

同系列芯片具有相同的中央处理单元、总线结构和指令集。片内存储器以及外设有所区别

中央处理单元:中央算术逻辑部分(算术逻辑运算,由累加器存放结果,输出数据定标移

位器进行移位

输入定标部分(将来自存储器的16位数据左移变成32位送往中央算数逻 辑单元 乘法部分

辅助寄存器算数单元(寻址+运算 状态寄存器

2.C2000总线结构特点

(1采用各自独立的数据地址总线分别用于数据读(DBAB和数据写(DW AB,因此CPU的读写可在一个周期内进行

(2 独立的程序空间和数据空间允许CPU同时访问程序指令和数据。3.引脚

DS(output:外部数据存储器选通引脚 PS(output :外部程序存储器选通引脚 IS(output :外部IO空间存储器选通引脚 R/W(output :读写选择信号

STRB(output :外部存储器访问选通引脚 READY(input :外设准备好信号

MP/MC(input:工作模式选择引脚。A0~A15:16位地址线 D0~D15:16位数据线

4.程序地址产生:程序计数器(利用16位的程序计数器PC对内部和外部程序存储器寻址

堆栈(16位宽、8级深度的硬件堆栈。功能:保存返回地址与重要数据 微堆栈(16位宽,1级深。功能:保存返回地址。无指令对微堆栈操作。流水线操作(4个独立阶段:取指令(Fetch、指令译码(Decode、取操作 数(Operand和执行指令(Execute。5.转移调用和返回指令

转移(跳转:使控制转换到新的地址单元

调用:使控制转换到新的地址单元,将返回地址压入堆栈 返回:使栈顶的地址弹出到程序计数器PC中

6.重复指令RPT:它的下一条指令重复被执行,执行次数是重复指令中操作数加一。

例如:RPT #N INST1 INST2 运行结果:INST1执行N+1次

7.中断控制(1中断分类

触发源角度:硬件中断(内部,外部,软件中断(指令触发 DSP管理中断角度:可屏蔽中断,不可屏蔽中断(2中断矢量表

又称为中断地址,表明中断发生后,若DSP响应中断,指令执行的地址。(3可屏蔽中断设置

中断标志寄存器IFR:中断请求到达CPU时为1 中断屏蔽寄存器IMR:为0,屏蔽中断 为1,中断

中断控制寄存器ICR:(4可屏蔽中断响应流程

中断请求-----中断响应-------中断服务(5非屏蔽中断

硬件非屏蔽中断:RS,NMI 软件非屏蔽中断:INTR k,NMI,TRAP(6中断服务程序ISR 中断服务程序是用户编写的,是对中断事件做出响应的子程序。

CPU 接收到中断请求并响应之后,就根据中断矢量内容转移到相应的中断服务程序ISR 中

(7复位:优先级最高的中断,属于非屏蔽外部中断(硬件 复位操作至少需要6个时钟周期 8.存储器与I/O 空间

(1存储器类型:程序存储空间,数据存储空间,IO 空间(2片内存储器与片外存储器

片内:速度快,功耗低,运行稳定,访问效率高。片内存储器类型:片内双访问存储器—DARAM 片内单访问程序/数据存储器—SARAM 掩膜型片内存储器—ROM 闪速存储器—FLASH 片外:容量大(3程序存储空间

功能:程序存储器存放程序的代码、表格信息、固定操作数。程序运行时只读。控制信号引脚:PS ,STRB, 扩展:两片8K ×8位存储器构成8Kx16位的静态存储器与C2000相连(4数据存储空间

功能:存放DSP 运行时所需要的数据,程序运行时可读写。

控制信号引脚:DS :当外部总线正被数据存储器使用时,DS 为低电平。STRB :当外部总线正被使用时,STRB 为低电平。BR :当访问全局数据空间时,BR 为低电平。

扩展:2个8K 8bit 的RAM 完成8K 16bit 静态存储器与C2000的接口 本地数据空间:直接寻址,间接寻址

全局数据空间:用于保存与其他处理器共用的数据,引脚BR ,低电平访问全局(5I/O 空间 功能:输入输出

控制信号引:IS :当外部总线正被IO 空间使用时,IS 为低电平。STRB :当外部总线正被使用时,STRB 为低电平。访问方式:IN、OUT 指令(6程序引导

功能:在复位时,DSP 内部的引导程序把用户程序从外部的8位数据空间存储器中引导到内部的16位程序空间的RAM 中,从而开始运行用户程序

条件:DSP 复位时,BOOT 引脚必须为0。(7存储器配置 9.片内外设(1时钟产生器

(2定时器

定时器中断频率为

1(1(1++⨯=PRD TDDR f f clkout1TINT PRD为16位定时器周期寄存器;TDDR为4位(不超过15定时器除数寄存器;设置:PRD,TCR(3等待状态发生器

等待状态产生的两种方式:使用READY信号(低电平有效灵活,可以产生任 为任意外部设备产生等待周期

设置片内等待状态发生器(WSGR:方便,可靠;为某一空间设置整体的等待周期(4同步串行口

基本信号:时钟信号CLKX,帧同步信号FSX,数据信号DX.中断信号:发送中断XINT,接受中断RINT DSP与串口的访问方式:查询,中断 同步串行口发送模式: 利用内部帧同步的突发模式(FSM=1,TXM=1 利用外部帧同步的突发模式(FSM=1,TXM=0 利用内部帧同步的连续模式(FSM=0,TXM=1 利用外部帧同步的连续模式(FSM=0,TXM=0

同步串行口接收模式: 突发模式接收 连续模式接收(4异步串行口

基本信号:数据信号TX,TR,握手信号IO0~IO3 9.通用IO引脚 BIO,XF,IO0~IO3 第三章.TMS320C2000软件环境 1.寻址方式(1立即寻址 短立即数寻址方式

RPT #99;RPT后面的指令重复执行100次 长立即数寻址方式

ADD #16384,2;累加器与数值16384左移2位后相加(2直接寻址

必须首先对DP进行设置以确定数据页面,然后再书写进行某种操作的指令,该指令的操作数将确定数据页面内部的特定偏移单元。其步骤如下: LDP #20H;初始化数据页面指针

ADD 5Dh;累加器与当前数据页面内偏移量5DH单元的内容相加,结果存入累

加器中(3间接寻址

利用8个16位的辅助寄存器AR7~AR0,可提供灵活多变且功能强大的间接寻址方式。

LAR AR1,#289H MAR *,AR1 ADD *;ACC<=ACC+289H@DS C2000提供了4种修改方法供间接寻址选择

(1无增量或减量。指令使用当前AR内容作为数据存储器地址,指令执行完成后,当前AR 的内容保持不变。ADD *;ACC=ACC+(ARx(2加1或减1。指令使用当前AR内容作为数据存储器地址,然后将当前AR内容加1或减

1。ADD *+ ADD *-;ACC=ACC+(ARx, ARx=ARx-1(3加或减一个变址量。AR0中的值即是这个变址量。指令使用当前AR内容作为数据存储

器地址,然后将当前AR的内容和AR0的值相加或相减,结果送到当前AR中。

ADD *0+ ADD *0-;ACC=ACC+(ARx, ARx=ARx-AR0(4位翻转加或减一个变址量。AR0中的值即是这个变址量,指令使用当前AR内容作为数

据存储器地址,然后将当前AR内容与AR0的值位翻转后相加或相减,结果送到当前AR 中。

ADD *BR0+;ACC=ACC+(ARx, ARx=ARx+rc(AR0 ADD *BR0-2.汇编语言格式

[标号][:] 助记符[操作数1,操作数2,…][;注释]

例如: SYM1.set 2;符号SYM1等于2 BGN: LDP SYM1;将2装入DP.word 016H;初始化一个字为16h NOP;空操作

BCND BGN,BIO;引脚BIO为低电平跳转BGN LDP SYM+1;SYM1+1装入到DP

3.伪指令宏指令

4.COFF—公共目标文件格式

块的定义:目标文件中最小的单位,一个块就是最终在TMS320存储器映像中占据连续空间的一块代码或数据。

已初始化块:.text.data.sect.asect 未初始化块:.bss.usect 链接器的一个主要功能是将块定位到目标存储器中。

汇编器的主要任务是为确定汇编语言程序的各部分分别属于哪个特定的段。第四章.DSP系统设计 1.具体技术指标

采样频率-------由信号频率,带宽决定

由采样频率确定任务书中最复杂算法所需最大时间以及系统对实时性要求判断是能否完成工作。

片内RAM容量及是否扩展-----由数据量及程序长度决定 16/32位,定点/浮点-----------由系统精度决定

根据系统用途是计算还是控制,来决定对输入输出端口的要求。2.DSP目标板设计要素 步骤: 第一步:算法分析与优化

第二步:DSP的选择 第三步:DSP配置

第四步:模拟数字混合电路设计 第五步:系统电路设计

第六步:系统对软件的编写与调试 第七步:系统测试与验证 3.硬件设计步骤

确定硬件方案--------器件选型--------原理设计----------PCB版图设计--------硬件调试

(系 统 分 析 |(系 统 综 合

原理设计是DSP 系统集成中关键的一步,其成功与否是DSP 系统能否正常工作的最重要的一个因素。

3.软件设计步骤 4.系统集成

系统集成是将软硬件结合起来,并组装成一台样机,在实际系统中运行,进行系统测试。

5.高精度ADC 转换器结构:逐次逼近方式, Σ-Δ调制方式 积分方式

高速ADC 转换器结构:并行比较型

串-并比较型 分路转换型

6.高精度ADC 转换器应用: 精度与速度存在矛盾

对电源,接地,电路布局的要求都极为严格 外部电路的匹配 与后续电路之间的隔离 串行输出方式

高速ADC 转换器的应用: 电平逻辑的匹配 时序逻辑的匹配 高速器件的接地 高速器件的去耦

7.高速ADC 器件的选择:速度与精度折衷 保证裕量 避免全速运行

8.性能测试:动态有效位(ENOB 是用来衡量数据采集系统实际工作时有效的位数,它是用分辨率来衡量实际工作时ADC 的噪声均方值与理想ADC 标识分辨率情况下的量化噪声。

采用FFT 方法进行测试,具体方案是:(a 采用单频正弦信号输入到ADC;(b 对ADC 输出结果进行快速傅里叶变换FFT ,计算SINAD(Signal-to-Noise and Distortion Ratio ,信号噪声加失真比。

(c 有效位数ENOB=(SINAD-1.76/6.02。8.实时数据存储

双端口RAM :双端口存储器是一种专用存储芯片,设有两组物理地址、数据和读写控][log 10噪声能量能基频10量信号 SINAD 制信号。两个CPU可以通过这些控制信号同时访问双端口存储器,实现数据共享

(1双端口RAM构成的乒乓存储器 工作特点: 人为的将双端口存储器分成两部分,使得存储器的读写操作分时工作,即同一时刻内存储器的两部分处于不同的读写状态。

对A写数据时,则DSP从B中读取数据;对B写数据时,则DSP从A中读取数据;有效的增加了DSP运算处理时间,提高了系统的实时性(2先进先出存储器FIFO FIFO是一种先进先出的存储器,即先读入的数据先读出。FIFO器件常用作数据缓冲器,充当两个不同速率的系统之间的数据接口。

FIFO的共性:没有地址线,只有读写时钟,内部地址依赖于对读写时钟的计数。采用满、空、半满标志来标识存储状态。

9.高速实时信号的产生:数据存储型,相位累加型

10.高速电路定义:线传播延时大于数字信号驱动端上升时间的1/2,则可认为此类信号是高速信号并产生传输线效应。

从本质上讲,高速数字系统的设计的核心问题是如何确保系统时序的正确。11.信号的完整性:指信号线上信号的质量,主要包括反射、振铃、地弹和串扰 12.传输线效应:反射信号、串扰、过冲与下冲、电磁辐射

串扰:在一根信号线上有信号通过时,在PCB板上与之相邻的信号线就会感应出相关信号,这种现象叫做串扰。

串扰解决途径:加宽走线间距 导线尽可能接近地线 差分布线技术 正交布线

合理布局布线。。13.避免传输线效应的方法: 严格控制关键走线的长度 抑制电磁干扰

合理规划走线的拓扑结构 电源去耦技术

14.高速PCB技术

第五章.可编程逻辑器件在DSP系统中的应用 1.ASIC(专用集成电路 优势:体积小容量大 功耗低 可靠性高 保密性强 在线可编程能力

各种先进的开发手段大大缩短了开发周期 2.FPGA(现场可编程门阵列

既继承了门阵列逻辑器件密度高和通用性强的优点,又具备可编程逻辑器件的可编程特性。FPGA结构:查找表型,多路开关型

主要包括:可编程逻辑模块(CLB,可编程输入输出模块IOB,可编程内部互联PI 3.DSP与FPGA DSP:依赖于指令的串行执行完成算法功能,易于实现跳转、调用等功能 FPGA:依赖与内部的逻辑资源的自由并行组合实现算法功能 DSP与FPGA的方案选择依据:系统的取样速率 系统是否已经使用C语言编制的程序 数据率?

多少个条件操作? 是否使用浮点 所需要的库能否获得 4.DSP+FPGA结构

DSP+FPGA结构最大的特点是结构灵活,有较强的通用性,适于模块化设计,从而能够提高算法效率;同时其开发周期较短,系统易于维护和扩展

1.哈佛总线:PAB,DRAB,DWAB,DRAB,PRDB,DWEB 2.硬件设计:ADC.DAC.内存、电源、通信、逻辑控制、人机接口、总线 3.高速总线:PCI,PCB,VME 4.FPGA内部模块:可编程逻辑模块CLB,可编程输入输出模块IOB,可编程内部互联PI 5.DSP子系统:通用CPU,加速处理模块,专用DSP芯片,通用可编程DSP,可编程FPGA,单片机。

6.FPGA与DSP选取依据:正确选择单点接地与多点接地,分开数字模拟电路,加粗地线,将地线构成闭环回路

7.高速电路PCB布线原则:合理选择层数,缩短高频器件管脚间引线,减少连接过程用孔,减少管脚引线弯折,各类信号走线不能形成环路

DSP考试复习总结最终版 第6篇

第一章 TMS320LF240X 系列芯片的特点： ① 采用高性能 CMOS 技术，使得供电电压降为 3.3V，减少了控 制器的功耗；30MIPS 的执行速度使得指令周期缩短到 33ns（30MHz），从而提高了控制器的实时控制能力。② 基于 TMS320C2XX DSP 的 CPU 核，保证了 F240X 系列 DSP 代码与 TMS320 系列 DSP 代码兼容。③ 片内有高达 32K 字的 FLASH 程序存储器、高达 1.5K 字的数 据/程序 RAM、544 字双口 RAM（DRAM)和 2K 字的单口 RAM（SRAM）④ 两个事件管理器模块 EVA 和 EVB，每个包括：两个 16 位通 用定时器；8 个 16 位脉宽调制通道；3 个捕获单元，片内光电编 码器接口电路，16 通道 A/D 转换器。⑤ 可扩展的外部存储器（LF2407)总共 192K 字空间；64K 程序 存储器空间； 64K 字 I/O 寻址空间； 64K 字数据存储器空间。⑥ 10 位 A/D 转换器最小转换时间为 500ns，可选择由两个事件 管理器来触发的两个 8 通道输入 A/D 转换器或一个 16 通道 A/D 转换器。⑦ 控制器局域网 CAN2.0B； ⑧ 串行通信接口 SCI 模块。⑨ 16 位串行外设 SPI 接口模块； ⑩ 基于锁相环的时钟发生器。11 高达 40 个可单独编程或复用的 I/O 引脚 GPIO； 12 5 个外部中断（两个电机驱动保护、复位和两个可屏蔽中断。13 电源管理包括 3 种低功耗模式，能独立地将外设器件转入低 功耗工作模式。系统配置： 用来对 DSP 片内的功能模块进行用户配置，根据具 体用途来进行模块定制。中断模块：主要包括－中断优先级和 中断向量表、外设中断扩展控制器(PIE)、中断向量、中断响应的 流程、中断响应的时间、CPU 中断寄存器、外设中断寄存器、复 位、无效地址检测、外部中断控制寄存器。TMSLF240x DSP 具有 16 位地址线，可访问三个独立的地址空 间：1）程序存储器空间－64K 字；2）数据存储器空间－64K 字； 3）I/O 空间－64K 字。DSP 引脚从性质上分为：事件管理器 A（EVA）、事件管理器 B（EAB）、A/D 转换器 ADC、CAN SCI SPI、外部中断和时钟、振 荡器、PLL、FLASH、引导程序及其他、仿真和测试、地址、数 据和存储器控制信号、续表、供电电源。第二章 系统控制和状态寄存器 1（SCSR1），SCSR1 映射到数据存储器 空间的 7018h 位15：保留； 位14： CLKSRC，为CLKOUT引脚输出时钟源的选择位，0－CLKOUT 引脚输出CPU时钟；1－CLKOUT引脚输出WDCLK时钟。位13、12：LPM1，LPM0，低功耗模式选择，指明在执行IDLE 指令 后进入哪一种低功耗模式。00－进入IDLE1（LPM0）模式；01－进 入IDLE2（LPM1）模式；1x－进入 HALT（LPM2）模式。位11－9：CLK PS2-CLK PS0，（PLL）时钟预定标选择位，选择输 入时钟频率fin的倍频系数。000－4；001－2；010－1.33；011 －1；100－0.8；101

DSP原理及应用复习总结 第7篇

中央处理器的体系架构分为：冯·诺依曼结构和哈佛结构 冯·诺依曼结构，是一种将程序指令存储器和数据存储器合并在一起的存储器结构。由于取指令和存取数据要从同一个存储空间存取，经由同一总线传输，因而它们无法重叠执行，只有一个完成后再进行下一个。

哈佛结构是一种将程序指令存储和数据存储分开的存储器结构。可以减轻程序运行时的访存瓶颈。

基础特性分类：静态DSP芯片、一致性的DSP芯片。数据格式分类：定点DSP芯片、浮点DSP芯片。用途分类：通用型DSP芯片、专用型DSP芯片。处理数据位数分类：16/32位 TMS320F2812芯片封装方式两类：179引脚的GHH球形网格阵列BGA封装、176引脚的LQFP封装。

DSP内部总线分为：地址总线和数据总线。注意：DSP外部总线：即DSP芯片与外扩存储器的总线接口，包括19根地址线和16根数据线。

时序寄存器XTIMINGx主要用于设置读写时序参数；配置寄存器XINTCNF2主要完成选择是种，设置输入引脚状态及写缓冲器深度；控制寄存器XBANK用于设置可增加周期的特定区，以及设置增加的周期数。

命令文件CMD是DSP运行程序必不可少的文件，用于指定DSP存储器分配。由两个伪指令构成，即MEMORY(定义目标存储器的配置)和SECTIONS(规定程序中各个段及其在存储器中的位置)。

28X系列DSP时钟和系统控制电路包括：振荡器、锁相环、看门狗和工作模式选择等

锁相环和振荡器的作用是为DSP芯片中的CPU及相关外设提供可编程的时钟芯片内部的外设分为告诉我社和低速外设，可以设置不同的工作频率看门狗模块用于监控程序的运行状态，它是提高系统可靠性的重要环节。

28xDSP片上晶振电路模块允许采用内部振荡器或外部时钟源为CPU内核提供时钟

DSP处理器内核有16根中断线，包括和NMI两个不可屏蔽中断和INT1至INT14等14个可屏蔽中断（均为低电平有效）。PIE中断系统共分12组，每组有8个中断复用1个CPU中断。采用三级中断机制：外设级、PIE级、CPU级

PIE中断工作原理：当某外设产生中断，IF被置1，IE也被置1，发送到PIE控制器，中断标志PIEIFRx.v被置1，中断请求发送到CPU，CPU级IFR中对应INTx被置1，IER和INTM被使能，CPU响应中断请求。

CPU定时器用户只能用T0，通用定时器是EV中的都可以用;CPU定时器只有周期中断，而EV中的通用定时器可以有上溢中断、下溢中断、周期中断、比较中断四种。

功能控制寄存器：GPxMUX、GPxDIT、GPxQUAL。

数据寄存器：GPxSET寄存器设置每个引脚为高电平；GPxCLEAR清除每个引脚信号；GPxTOGGLE反转触发每个引脚信号；GPxDAT读写每个引脚信号

事件管理器包括：通用定时器、圈比较PWM单元、捕获单元以及正交编码脉冲电路QEP 全比较PWM单元产生脉宽调制信号可以控制直流电机或步进电机的转速；捕获单元对光电编码器的输出信号进行测量可以计算电机的转速；正交编码脉冲电路根据增量编码器信号计算电机的旋转方向等信息。

通用定时器的寄存器：控制寄存器（决定通用定时器的操作模式，例如选择计数模式、时钟、预分频系数、比较寄存器的重装载条件）、全局控制寄存器(规定了通用定时器针对不同时间采取的动作、读取计数方向、定义ADC的启动信号)、比较寄存器(与通用定时器的计数值不断比较，匹配时，相应引脚跳变，请求中断)和周期寄存器(决定定时器的计数周期)是双缓冲的

通用定时器的中断：上溢中断、下溢中断、比较匹配、周期匹配

每个通用定时器都支持4种计数模式：停止/保持模式、连续递增计数模式、定向递增/递减计数模式和连续递增/递减计数模式。

EV模块各有3个全比较器，每个比较器对应两路PWM输出

每个比较单元包括3个比较寄存器CMPRX，各带一个映像寄存器；1个比较控制寄存器；1个动作控制寄存器；6路带三态输出的PWM引脚以及控制和中断逻辑。

较单元的输入包括来自控制寄存器的控制信号，通用定时器1的时钟信号及下溢信号、周期匹配信号和复位信号。比较单元输出信号是一个比较匹配信号，如果比较操作被使能的话，比价匹配信号将中断标志置位，并在对应的PWM引脚上产生跳变。比较单元的工作过程：通用定时器1的计数值不断地与比较寄存器的值进行比较，当发生匹配时，该比较单元的两个输出引脚发生跳变；ACTRA寄存器定义在发生比较匹配时每个输出引脚为高有效电平或低有效电平。

PWM单元对称/不对称波形发生器、可编程死区单元DBU、PWM输出逻辑和空间向量SVPWM状态机组成。ADC模块的特点：12位模数转换内核，内置双采样/保持器；顺序采样模式或并行采样模式；模拟输入电压范围0-3v；快速的转换时间，最高采样率12.5MSPS；16通道模拟信号输入； 并行采样：AdcRegs.ADCTRL3.bit.SMODE_SEL=1;顺序采样为0 双排序AdcTegs.ADCTRL1.bit.SEQ_CASC=0;级联排序为1 AdcRegs.ADCMAXCONV.all=0x0033并双；7并级；77顺双；F顺级 AdcRegs.ADCCHSELSEQ1.bit.CONV00=0x0 ADC工作模式：连续模式和启动/停止模式。ADC电源：上电、掉电、关闭模式。

上电顺序：给参考电源上电、给adc内部参考电源电路供电、adc模块完全供电后，等20μs才能执行第一次模数转换。

28x DSP的输入信号电压不能高于3.3V，模拟信号需经过调理后进入DSP的AD转换输入端口，未使用的模数转换器输入引脚，都要连接模拟地，否则会带来噪声信号

电源管理电路设计：多电源正确连接；不允许有电源引脚悬空；减少噪音和互相干扰，数电和模电单独供电，接地也分开，最终通过一个磁珠在单点连接

DSP编程语言特点：c语言：具有良好可读性和可移植性，开发率高；汇编语言：高的运行效率，常用语时间要求比较苛刻的地方，比如终端服务子程序。

头文件的作用：是c语言不可缺少的部分，是用户程序和函数库之间的纽带；头文件使用：用户程序只要按照头文件中的接口声明来调用库功能，编译器就会从库中提取相应的代码 C语言程序框架包含有寄存器结构定义文件、外设头文件、器件的宏与类型定义等，通过使用头外设文件，可以容易控制片内外设。

DSP程序包括：头文件包含、函数声明、宏定义、主函数main()和中断服务子程序

主函数的编程步骤：1初始换系统控制2清除所有中断并初始化PIE向量表3初始化所有用到的外设4开中断5编写用户代码 #include “DSP281x_Device.h”

#include “DSP281x_Examples.h”

interrupt void cpu_timer0_isr(void)； void main(void)// {

InitSysCtrl()； DINT；

InitPieCtrl()；

IER = 0x0000；

IFR = 0x0000；

InitPieVectTable()； EALLOW；

PieVectTable.TINT0 = &cpu_timer0_isr；

EDIS;InitGpio();InitCpuTimers();

ConfigCpuTimer(&CpuTimer0,100,1000000);

StartCpuTimer0();IER |= M_INT1；

PieCtrlRegs.PIEIER1.bit.INTx7 = 1；

EINT；

ERTM； …… }

interrupt void cpu_timer0_isr(void)

{

CpuTimer0.InterruptCount++；

PieCtrlRegs.PIEACK.all = PIEACK_GROUP1；

定点dsp与浮点dsp的比较 第8篇

定点运算DSP在应用中已取得了极大的成功，而且仍然是DSP应用的主体。然而，随着对DSP处理速度与精度、存储器容量、编程的灵活性和方便性要求的不断提高、自80年代中后期以来，各DSP生产厂家陆续推出了各自的32bit浮点运算DSP。

和定点运算DSP相比，浮点运算DSP具有许多优越性：

浮点运算DSP比定点运算DSP的动态范围要大很多。定点DSP的字长每增加1bit,动态范围扩大6dB。16bit字长的动态范围为96dB。程序员必须时刻关注溢出的`发生。例如，在作图像处理时，图像作旋转、移动等，就很容易产生溢出。这时，要么不断地移位定标，要么作截尾。前者要耗费大量的程序空间和执行时间，后者则很快带来图像质量的劣化。总之，是使整个系统的性能下降。在处理低信噪比信号的场合，例如进行语音识别、雷达和声纳信号处理时，也会发生类似的问题。而32bit浮点运算DSP的动态范围可以作到1536dB，这不仅大大扩大了动态范围，提高了运算精度，还大大节省了运算时间和存储空间，因为大大减少了定标，移位和溢出检查。

由于浮点DSP的浮点运算用硬件来实现，可以在单周期内完成，因而其处理速度大大高于定点DSP。这一优点在实现高精度复杂算法时尤为突出，为复杂算法的实时处理提供了保证。

32bit浮点DSP的总线宽度较定点DSP宽得多，因而寻址空间也要大得多。这一方面为大型复杂算法提供了可能、因为省的DSP目标子程序已使用到几十MB存储器或更多；另一方面也为高级语言编译器、DSP操作系统等高级工具软件的应用提供了条件。

DSP的进一步发展，必然是多处理器的应用。新型的浮点DSP已开始在通信口的设置和强化、资源共享等方面有所响应。

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DSP简介 第9篇

1． 什么是DSP芯片

DSP芯片，也称数字信号处理器，是一种具有特殊结构的微处理器。DSP芯片的内部采用程序和数据分开的哈佛结构，具有专门的硬件乘法器，广泛采用流水线操作，提供特殊的DSP 指令，可以用来快速地实现各种数字信号处理算法。根据数字信号处理的要求，DSP芯片一般具有如下的一些主要特点：

（1）在一个指令周期内可完成一次乘法和一次加法。（2）程序和数据空间分开，可以同时访问指令和数据。

（3）片内具有快速RAM，通常可通过独立的数据总线在两块中同时访问。

（4）具有低开销或无开销循环及跳转的硬件支持。（5）快速的中断处理和硬件I/O支持。

（6）具有在单周期内操作的多个硬件地址产生器。（7）可以并行执行多个操作。

（8）支持流水线操作，使取指、译码和执行等操作可以重叠执行。与通用微处理器相比，DSP芯片的其他通用功能相对较弱些。2.DSP芯片的发展

世界上第一个单片DSP芯片是1978年AMI公司宣布的S2811，1979年美国Iintel公司发布的商用可编程期间2920是DSP芯片的一个主要里程碑。这两种芯片内部都没有现代DSP芯片所必须的单周期芯片。1980年。日本NEC公司推出的μPD7720是第一个具有乘法器的商用DSP 芯片。第一个采用CMOS工艺生产浮点DSP芯片的是日本的Hitachi 公司，它于1982年推出了浮点DSP芯片。1983年，日本的Fujitsu公司推出的MB8764，其指令周期为120ns，且具有双内部总线，从而处理的吞吐量发生了一个大的飞跃。而第一个高性能的浮点DSP芯片应是AT&T公司于1984年推出的DSP32。

在这么多的DSP芯片种类中，最成功的是美国德克萨斯仪器公司（Texas Instruments，简称TI）的一系列产品。TI公司灾982年成功推出启迪一代DSP芯片TMS32010及其系列产品TMS32011、TMS32C10/C14/C15/C16/C17等，之后相继推出了第二代DSP芯片TMS32020、TMS320C25/C26/C28，第三代DSP芯片TMS32C30/C31/C32，第四代DSP芯片TMS32C40/C44，第五代DSP芯片TMS32C50/C51/C52/C53以及集多个DSP于一体的高性能DSP芯片TMS32C80/C82等。

自1980年以来，DSP芯片得到了突飞猛进的发展，DSP芯片的应用越来越广泛。从运算速度来看，MAC（一次乘法和一次加法）时间已经从80年代初的400ns（如TMS32010）降低到40ns（如TMS32C40），处理能力提高了10多倍。DSP芯片内部关键的乘法器部件从1980年的占模区的40左右下降到5以下，片内RAM增加一个数量级以上。从制造工艺来看，1980年采用4μ的N沟道MOS工艺，而现在则普遍采用亚微米CMOS工艺。DSP芯片的引脚数量从1980年的最多64个增加到现在的200个以上，引脚数量的增加，意味着结构灵活性的增加。此外，DSP芯片的发展，是DSP系统的成本、体积、重量和功耗都有很大程度的下降。

3.DSP芯片的分类

DSP的芯片可以按照以下的三种方式进行分类。（1）按基础特性分

这是根据DSP芯片的工作时钟和指令类型来分类的。如果DSP芯片在某时钟频率范围内的任何频率上能正常工作，除计算速度有变化外，没有性能的下降，这类DSP芯片一般称之为静态DSP芯片。

如果有两种或两种以上的DSP芯片,它们的指令集和相应的机器代码机管脚结构相互兼容,则这类DSP芯片称之为一致性的DSP芯片。（2）按数据格式分

这是根据DSP芯片工作的数据格式来分类的。数据以定点格式工作的DSP芯片称之为定点DSP芯片。以浮点格式工作的称为DSP芯片。不同的浮点DSP芯片所采用的浮点格式不完全一样，有的DSP芯片采用自定义的浮点格式，有的DSP芯片则采用IEEE的标准浮点格式。（3）按用途分

按照DSP芯片的用途来分，可分为通用型DSP芯片和专用型的DSP芯片。通用型DSP芯片适合普通的DSP应用，如TI公司的一系列DSP芯片。专用型DSP芯片市为特定的DSP运算而设计，更适合特殊的运算，如数字滤波，卷积和FFT等。4.DSP芯片的基本结构 DSP芯片的基本结构包括：

（1）哈佛结构。哈佛结构的主要特点是将程序和数据存储在不同的存储空间中，即程序存储器和数据存储器是两个相互独立的存储器，每个存储器独立编址，独立访问。与两个存储器相对应的是系统中设置了程序总线和数据总线，从而使数据的吞吐率提高了一倍。由于程序和存储器在两个分开的空间中，因此取指和执行能完全重叠。

（2）流水线操作。流水线与哈佛结构相关，DSP芯片广泛采用流水线以减少指令执行的时间，从而增强了处理器的处理能力。处理器可以并行处理二到四条指令，每条指令处于流水线的不同阶段。

（3）专用的硬件乘法器。乘法速度越快，DSP处理器的性能越高。由于具有专用的应用乘法器，乘法可在一个指令周期内完成。

（4）特殊的DSP指令。特殊的DSP指令DSP芯片是采用特殊的指令。

（5）快速的指令周期。快速的指令周期哈佛结构、流水线操作、专用的硬件乘法器、特殊的DSP指令再加上集成电路的优化设计可使DSP芯片的指令周期在200ns以下。

5.DSP系统的特点

数字信号处理系统是以数字信号处理为基础，因此具有数字处理的全部特点：

（1）接口方便。DSP系统与其它以现代数字技术为基础的系统或设备都是相互兼容，这样的系统接口以实现某种功能要比模拟系统与这些系统接口要容易的多。

（2）编程方便。DSP系统种的可编程DSP芯片可使设计人员在开发过程中灵活方便地对软件进行修改和升级。

（3）稳定性好。DSP系统以数字处理为基础，受环境温度以及噪声的影响较小，可靠性高。

（4）精度高。16位数字系统可以达到的精度。

（5）可重复性好。模拟系统的性能受元器件参数性能变化比较大，而数字系统基本上不受影响，因此数字系统便于测试，调试和大规模生产。（6）集成方便。DSP系统中的数字部件有高度的规范性，便于大规模集成。

6.DSP芯片的应用

现代数字信号处理器是执行高速数字信号处理的IC电路、它恰好适应多媒体信息化社会需求，迅速发展壮大。如今，世界电子器件市上，各种各样的DSP器件已相当丰富。大大小小封装形式的DSP器件，已广泛应用于各种产品的生产领域，而且DSP的应用领域仍在不断地扩大，发展迅速异常。（1）数字化移动电话

数字化移动电话尽管花样繁杂，但基本上可划为两大类：高速移动电话和低速移动电话。其中，高速移动电话顾名思义是在高速移动体里使用的电话，诸如可在飞机、轮船和汽车等里自由通话的电话。虽然数字化高速移动通过标准很多，但当今普遍应用的是欧洲GSM（GlobalSystemforMobileCommunication）标准。自从推出数字化蜂窝式电话机以来，现已遍布全球70多个国家广泛应用。俗称GSM标准的数字化蜂窝电话，叫作数字化大哥大，它具备国际漫游（Roaming）功能，SIMC（SubscriberIdentificationModuleCard）给用户带来使用大哥大的方便。现正在扩展数据通信服务能力以及它与ISDN系统兼容性，例如，英国BT公司的Cellnet部已经利用GSM提供数字化数据和传真服务，于是东芝笔记本电脑也安上了数字化的大哥大。

低速移动电话就其实质而论。它是数字化无绳电话，仍然保持模拟式无绳电话的子母式结构：子机亦称为手机，可以距母机为百米左右半径内的空间里自由步行移动情况下实现通话；母机也称为基地站，可作为家庭里的留守电话，也可悬挂在商店的墙壁上，街道的电线柱上，广为分布。由统一的交换设施进行管理，实现无缝交递（SeamlessHandOn）功能。这类低速移动电话式标准很多。例如，欧洲较为普遍应用的DECI（DigitalEuropeanCordlessTelecommunictaion），日本、韩国、东南亚应用的PHS（PersonalHandy－phoneSystem）以及Philips和我国联合开发的DCCT（DigitalChinaCordlessTelephone）。其中，尤以PHS和DECT制式低速移动电话发展较快，我国的DCCT由于缺乏关键性的DSP技术仍处于设计阶段。

数字化移动电话（包括高速和低速）的每个手机，都要用至少1个DSP器，因此，高速发展的数字化移动电话急需极为大量的DSP器件。（2）数据调制解调器

从所周知，数字信号处理器的传统应用领域之一，就是调制解调器。如今，调制解调器作为联系通信与多媒体信息处理系统的纽带，日益受到重视。特别是近年来Internet热潮，方兴未艾，普通百姓在Internet上冲浪蔚然成风。利用PC机通过调制解调器经由电话线路，实现拨号连接Internet已是最简便的访问形式。由于Internet用户急剧增加，一度致使28．8Kbps的调制解调器成为市场上的脱销产品。特别是由PC机上利用浏览程序调用活动图像信息时，期望使用数据传送速度更高的调制解调器。为适应这种新需求，国际上已制订出高速（33．6Kbps）调制解调器国际标准。这就意味，在高速调制解调器里需要更高性能的DSP器件。这种33．6Kbps的调制解调器（V．34）

是为传送数据而设计的，在此基础上发展出DSVD调制解调器，它既可传送数据又可传送声音。无疑，这样一来将需要更高功能的DSP器件。

随着高性能调制解调器不断出现，似乎低速的调制解调器如像V．17（14．4Kbps）再也没有用武之地。事实上，刚刚相反，如今信息家电抬头，例如PHS母机留守电话与个人FAX一体化的产品大量上市。这就是说，V．17（14．4Kbps）型的调制解调器仍有市场。于是，各种调制解调器里要求的DSP也是多种多样的。

（3）磁盘／光盘控制器需求

随着多媒体信息化的发展，各种信息存储媒体产品都应运而生，诸如磁盘存储器、CD－ROM和DVD（DigitalVersatileDisk）－ROM新产品纷纷上市。今日的磁盘驱动器HDD，存储容量已相当可观，大型HDD姑且不谈，就连普通PC机的HDD的存储容量已高在1GB以上，详见照片4。小型HDD向高密度、高存储容量和高速存取方向发展，其控制器必须具备高精度和高速响应特性，它所用的DSP性能也是今非昔比，高速DSP是必不可少的关键性器件。

日本的HDD技术不能超过美国，于是把主攻方向集中到光盘技术，在1996年日本第35届ElectronicsShow＇96上，终于把DVD－ROM产品公布于众。而且，日本并不以此为满足，志在夺取可擦写的DVD－RAM。仅就DVD－ROM而论，单面1片12cm盘片记录4．7GB信息量，相当于直径12cm的软盘FD片3200张之多，比CD－ROM存储容量高出6倍。如此高密度的DVD－ROM，读出控制的精细程度可想而知。

HDD和光盘机的控制器里之所以必须利用高速DSP，主要是利用其高速“积和”处理能力。因为，盘片旋转控制、磁头定位控制和光盘中的激光束聚焦控制，都是采数字伺服与系统控制技术。这是现在控制技术，建立在数学模型基础之上。通过复杂的矩阵运算实现控制。没有高速运算的DSP，是绝对不行的。（4）图形图像处理需求

DVD里应用的活动图像压缩／解压缩用MPEG2编码／译码器，同时也广泛地应用于视频点播VOD、高品位有线电视和卫星广播等诸多领域。在这些领域里，应用的DSP应该具备更高的处理速度和功能。而且，活动图像压缩／解压技术也日新月异，例如，DCT变换域编码很难提高压缩比与重构图像质量，于是出现了对以视觉感知特性为指导的小波分析图像压缩方法。新的算法出现，要求相应的高性能DSP。最近，日本各大学和高技术企业对于开发虚拟现实VR系统，投入相当力量，利用现代计算机图像学CG生成3维图形，迫切需要多个DSP并行处理系统。其中，系统里的结点DSP单元，要求采用与并行处理相适应的体系结构。

彩色静止图像压缩／解压，现在普遍应用JPEG标准，其核心算法也是离散余弦变换。JPEG编码／译码器的应用，除了数字化照像机之外，估计彩色打印机和彩色扫描器也将要应用。因此，对于普通DSP的用量，必将日益增长。

（5）汽车电子系统及其它应用领域

汽车电子系统日益兴旺发达起来，诸如装设红外线和毫米波雷达，将需用DSP进行分析。如今，汽车愈来愈多，防冲撞系统已成为研究热点。而且，利用摄像机拍摄的图像数据需要经过DSP处理，才能在驾驶系统里显示出来，供驾驶人员参考。