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DDS-PLL组合跳频频率合成器

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收稿日期! "###$%&$%’第一作者! 男"#’(年生教授"%")"* 北京第 ""卷第 ’期+%%%年 *月指 挥 技 术 学 院 学 报,-./012-3405676.68-39-::10;10;<8=>0-2-?@A-2B"" C-B’DDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDDD,.0E+%%%FFGHIJJ组合跳频频率合成器陈世伟李玉伟冯杰K装备指挥技术学院试验工程系L摘要为了弥补数字式频率合成KMMNL和集成锁相环KOOPL各自的不足Q研制并设计了以 RM(%%S为核心的 MMN芯片及集成锁相环芯片 T9")&"&+构成的频率合成器U该频率合成器的输出频率范围!#%%V"%%%TWXY频率步进!"+E+ZWXY杂散[\*%;]H5Y转换时间[":5U关键词MMNYOPPY跳频分类号&&’的频率分辨率非常高3所以合成器可得到高的频率分辨率>由于合成器的分辨率由&&’决定3)**可以工作在较高的鉴相频率上3这对提高合成器的频率转换时间有益>输出信号的相位噪声和杂波的性能主要由 /01决定>环路带宽内3&&’的输出产生下述情况>?9由相位截断误差引起的杂波信号经 )**后在功率上增加 (@AB8%98CD93偏离主频的位置不变>(9由幅度量化引起的杂散是调幅杂波3非线性可以将这种调幅杂波转换成调相杂波3因为 % 次倍频不会影响到调幅信号的调制指数3所以非线性的 )**电路会抑制这种杂波信号>在实际工程中3可采用的较好方法是在 )**之前置硬限幅器3以便更好的抑制调幅杂波信号>;9由 &E0非线性引起的杂波为附加的离散杂波3由于 )**的倍频作用使之在功率上增加 (@AB8%98CD93偏离主频的位置不变>F9由 &&’电路产生的附加噪声经 )**后功率增加 (@AB8%9G;8CD9>除以上特点外3电路简单H使用硬件少和低功耗也是明显的特点>尤其是 &&’与 )**都使用集成电路时3结构非常简单>为降低相位噪声和设计电路的难度3选用了 &&’激励锁相环的方案>具体结构如图 ;所示"I##JJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJ#!II#!!" ####JJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJJII####>图 ; &&’K)**组合频率合成器构成框图L )**部分隔离放大/01*2M N0?FO?O?G?前置分频N0?(@((E频率控制P@;?$Q$6)&控制逻辑$RS &&’部分带通滤波器限幅放大数模转换器TUVK7,T函数表相位累加器参考频率源?;第 ;期陈世伟3等<&&’K)**组合跳频频率合成器万方数据! 电路设计整个电路分为 ""#部分和 $%%部分&""#部分的核心是 ’"())*&另外还包括 ’"())*的外围电路及限幅放大+带通滤波等,$%%部分包括 ...

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